EDA技术实用教程Verilog HDL版学习报告.docx
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EDA技术实用教程VerilogHDL版学习报告
可编程逻辑器件与EDA技术
学习报告
院系:
自动化工程学院电子学系
专业:
电子信息科学与技术
班级:
2009级2班
姓名:
何伍健
2011年7月2日
一、EDA技术概述
1.1EDA技术及其发展
20世纪70年代,在集成电路制作方面,双极工艺,MOS工艺已得到广泛的应用;20世纪80年代,集成电路设计进入了CMOS(互补场效应管)时代;
20世纪90年代,集成电路设计工艺进入了超深亚微米阶段;
21世纪,全方面进入了EDA时代。
1.2EDA技术实现目标
1.可编程逻辑器件
2.半定制或全定制ASIC
(1)门阵列ASIC
(2)标准单元ASIC
3.混合ASIC
硬件描述语言VerilogHDL
HDL
和SystemC
其他常用HDL
VHDL与Verilog相比,有下列优势:
1.语法比Verilog严谨,通过EDA工具自动语法检查,易排除许多设计中的疏忽;
2.有很好的行为级描述能力和一定的系统级描述能力,而Verilog建模时,行为与系统级抽象及相关描述能力不及VHDL。
与Verilog相比,有下列不足:
代码较冗长,在相同逻辑功能描述时,Verilog的代码比VHDL少许多;
对数据类型匹配要求过于严格,初学时会感到不是很方便,编程耗时也较多;而Verilog支持自动类型转换,初学者容易入门;
对版图级,管子级这些较为低层的描述级别,几乎不支持,无法直接用于集成电路低层建模。
SystemVerilog主要定位于集成电路的实现和验证流程,并为系统级设计流程提供了强大的链接能力。
SystemC是C++语言的硬件描述扩展,主要用于ESL(电子系统级)建模与验证。
1.5HDL综合
1.从自然语言转换到VerilogHDL语言算法表述,即自然语言综合;
2.从算法表述转换到寄存器输出级表述,即行为综合;
3.从RTL级表述转换到逻辑门的表述,即逻辑综合;
4.从逻辑门表述转换到版图级表述,或转换到FPGA的配置网标文件,可称为版图综合或结构综合。
自顶向下的设计技术
1.7EDA技术的优势
1.大大降低设计成本,缩短设计周期。
2.有各类库的支持。
3.简化了设计文档的管理。
4.日益强大的逻辑设计仿真测试技术。
5.设计者拥有完全的自主权,再无受制于人之虞。
6.设计语言标准化,开发工具规范化,设计成果通用性,良好的可移植与可测试性,为系统开发提供了可靠的保证。
7.能将所有设计环节纳入统一的自顶向下的设计方案中。
8.整个设计流程上充分利用计算机的自动设计能力,在各个设计层次上利用计算机完成不同内容的仿真模拟,而且在系统板设计结束后仍可利用计算机对硬件系统进行完整全面的测试。
1.8EDA设计流程
1.9ASIC及其设计流程
1.9.1ASIC设计简介
1.9.2ASIC设计一般流程简述
1.10常用EDA工具
设计输入编辑器,HDL综合器,仿真器,适配器和下载器。
1.11QuartusII概述
1.12IP核
软IP,固IP,硬IP。
1.13EDA技术发展趋势管窥
1.在一个芯片上完成系统级的集成已成为可能。
2.可编程逻辑器件开始进入传统的ASIC市场。
工具和IP核应用更为广泛。
4.高性能的EDA工具得到长足的发展,其自动化和智能化程度不断提高,为嵌入式系统设计提供了功能强大的开发环境。
5.计算机硬件平台性能大幅度提高,为复杂的SOC设计提供了物理基础。
二、可编程逻辑器件原理
1可编程逻辑器件的发展历程与分类
世纪70年代,熔丝编程的PROM和PLA器件是最早的可编程逻辑器件;
世纪70年代末,对PLA进行了改进,AMD公司推出PAL器件;
世纪80年代初,Lattice发明电可擦写的,比PAL使用更灵活的GAL器件;
世纪80年代中期,Xilinx公司提出现场可编程概念,同时生产出了世界上第一片FPGA器件。
同一时期,Altera公司推出了EPLD器件,比GAL器件有更高的集成度,可以用紫外线或电擦除;
世纪80年代末,Lattice公司又提出在系统可编程技术,并且推出了一系列具备在系统可编程能力的CPLD器件,将可编程逻辑器件的性能和应用技术推向一个全新的高度;
6.进入20世纪90年代后,可编程逻辑集成电路技术进入了飞速发展时期。
器件可用逻辑门数超过了百万门,并出现了内嵌复杂功能模块的SOPC。
图2-1PLD按集成度分
2FPGA和CPLD的结构原理
图2-2MAX3000A系列的单个宏单元结构
2.1查找表逻辑结构
图2-3FPGA查找表单元内部结构
2.2CycloneIII系列器件的结构原理
图2-4CycloneIIILE结构图
3FPGA/CPLD的编程与配置
图2-5CPLD编程下载连接图
图2-6JTAG在线配置FPGA的电路原理图
图2-7用89S52进行配置
三、Verilog语言总结
语言的程序结构
1.模块表述
2.端口语句,端口信号名和端口模式
3.赋值语句与条件操作符
4.关键字
5.标识符
6.规范的程序书写格式
7.文件取名和存盘
语句
Assign目标变量名=驱动表达式;
AssignDout=a&b;
AssignDout=a&b|c;
AssignDout=e&f|d。
语句块
Always说明语句在仿真一开始就执行,语句后面跟着的过程块是否运行,要看它的触发条件是否满足,如满足则运行过程块一次,再次满足在运行一次,直到仿真结束。
有边沿触发和电平触发两种,一个模块中可以有多个always块,并且都是并行运行的。
4.阻塞赋值与非阻塞赋值的区别
阻塞赋值:
目标变量名=驱动表达式
非阻塞赋值:
目标变量名<=驱动表达式
图3-1例5-6综合后的RTL电路图3-2例5-5综合后的RTL电路
5.如何用always语句块设计组合电路和时序电路
边沿触发的always块常常描述时序行为,如有限状态机。
如果符合可综合风格要求,则可通过综合工具自动地将其转换为寄存器组和门级组合的逻辑结构,而该结构应具有时序所要求的行为。
电平触发的always块常常用来描述组合逻辑的行为。
如果符合可综合风格要求,则可通过综合工具自动地将其转换为表示组合逻辑的门级逻辑结构或带锁存器的组合逻辑结构,而该结构应具有所要求的行为。
6.如何用always语句设计异步控制和同步控制
含异步复位/时钟使能型触发器
同步复位型触发器
7.条件完整的if语句与条件不完整的if语句
8.如何实现三态控制和双向信号设计
三态控制电路设计
图3-34位三态控制门电路
双向端口设计
图3-41位双向端口电路设计之RTL图
四、QuartusII软件使用方法
1.设计流程
步骤1:
建立工作库文件夹---步骤2:
输入设计项目原理图或硬件描述语言---步骤3:
存盘,注意原理图或硬件描述语言取名---步骤4:
创建工程并将设计文件加入工程中---步骤5:
选择目标器件---步骤6:
启动编译---步骤7:
建立仿真波形文件---步骤8:
仿真测试与分析---步骤9:
选定工作模式,引脚锁定并编译---步骤10:
编程下载---步骤11:
硬件测试。
2.宏功能模块定制方法
例如:
LPM_ROM模块的设置
1.建立.mif或.hex格式文件
例如直接编辑法:
,或文件编辑法,C软件生成,专用生成器,汇编器。
2.定制
(1)打开宏功能块调用管理器
图4-1定制新的宏功能块
图4-2调用单口LPMRAM
(2)设置参数后,单击NEXT
图4-3设定RAM参数
图4-4设定RAM仅输入时钟控制
图4-5设定在写入同时读出原数据:
OldData
图4-6设定初始化文件和充许在线编辑
图4-7在原理图上连接好的RAM模块
3.嵌入式逻辑分析仪的功能和使用方法
1打开SignalTapII的编辑窗口
图4-8SignalTapII编辑窗口
2调入待测信号
图4-9输入逻辑分析仪测试信号
3SignalTapII的参数设置
图4-10SignalTapII编辑窗口
4文件存盘
图4-11选择或删除SignalTapII文件加入综合编译
5编译下载
图4-12设定SignalTapII对FPGA的通信接口
6启动SignalTapII进行采样与分析
图4-13下载并启动SignalTapII
图4-14SignalTapII数据窗口设置后的信号波形
7SignalTapII其他设置与控制方法
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