计算机组成原理大作业Word格式文档下载.docx
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软件介绍
ISE的全称为IntegratedSoftwareEnvironment,即“集成软件环境”,是Xilinx公司的硬件设计工具。
它可以完成FPGA开发的全部流程,包括设计输入、仿真、综合、布局布线、生成BIT文件、配置以及在线调试等,功能非常强大。
ISE除了功能完整,使用方便外,它的设计性能也非常好,拿ISE9.x来说,其设计性能比其他解决方案平均快30%,它集成的时序收敛流程整合了增强性物理综合优化,提供最佳的时钟布局、更好的封装和时序收敛映射,从而获得更高的设计性能。
模块介绍
微程序控制器
微程序控制器是一种控制器,同组合逻辑控制器相比较,具有规整性、灵活性、可维护性等一系列优点,因而在计算机设计中逐渐取代了早期采用的组合逻辑控制器,并已被广泛地应用。
在计算机系统中,微程序设计技术是利用软件方法来设计硬件的一门技术。
微程序控制的基本思想,就是仿照通常的解题程序的方法,把操作控制信号编成所谓的“微指令”,存放到一个只读存储器里。
当机器运行时,一条又一条地读出这些微指令,从而产生全机所需要的各种操作控制信号,使相应部件执行所规定的操作。
采用微程序控制方式的控制器称为微程序控制器。
所谓微程序控制方式是指微命令不是由组合逻辑电路产生的,而是由微指令译码产生。
一条机器指令往往分成几步执行,将每一步操作所需的若干位命令以代码形式编写在一条微指令中,若干条微指令组成一段微程序,对应一条机器指令。
在设计CPU时,根据指令系统的需要,事先编制好各段微程序,且将它们存入一个专用存储器(称为控制存储器)中。
微程序控制器由指令寄存器IR、程序计数器PC、程序状态字寄存器PSW、时序系统、控制存储器CM、微指令寄存器以及微地址形成电路、微地址寄存器等部件组成。
执行指令时,从控制存储器中找到相应的微程序段,逐次取出微指令,送入微指令寄存器,译码后产生所需微命令,控制各步操作完成。
算术逻辑单元ALU
算术逻辑单元ALU集成了各种算术运算和逻辑运算部件的功能,包括加、减、乘、除等数值运算、逻辑运算、移位运算等。
把这些功能集成在一个逻辑部件ALU之中,使得ALU具有算术运算和逻辑运算功能。
这种设计方法可以使得功能比较紧凑,简化对逻辑运算部件和算术运算部件的使用。
同时还能最大限度的复用某些逻辑部件,从而减少逻辑电路的使用。
某些处理器中,将ALU切分为两部分,即算术单元(AU)与逻辑单元(LU)。
某些处理器包含一个以上的AU,如,一个用来进行定点操作,另一个进行浮点操作。
(个人计算机中,浮点操作有时由被称为数字协处理器的浮点单元完成)。
通常而言,ALU具有对处理器控制器、内存及输入输出设备的直接读入读出权限。
输入输出是通过总线进行的。
输入指令包含一个指令字,有时被称为机器指令字,其中包括操作码,单个或多个操作数,有时还会有格式码;
操作码指示ALU机要执行什么操作,在此操作中要执行多少个操作数。
比如,两个操作数可以进行比较,也可以进行加法操作。
格式码可与操作码结合,告知这是一个定点还是浮点指令;
输出包括存放在存储寄存器中的结果及显示操作是否成功的设置。
如操作失败,则在机器状态字中会有相应的状态显示。
实验目的
1.通过控制器的微程序设计,综合理解计算机组成原理课程的核心知识并进一步建立整机系统的概念。
2.培养综合实践及独立分析、解决问题的能力。
实验内容
整个过程由微程序控制,alu_74181由四位改成八位,而romc则由四位改为11位,它们分别代表:
oen1,oen2,w1,w2,w3,gwe1,gwe2,gwe3,oen_n1,oen_n2,oen_n3。
当它们分别在相同时刻有效或无效时,表示一条微指令,则在不同时刻有不同微指令,而这些微指令则组成了实现程序过程的指令,从而实现程序。
第二章原理图
第三章管脚分配
###------------Atlysswitchinput----------
NET"
S[3]"
LOC=P12;
#Atlyssw4
S[2]"
LOC=R5;
#Atlyssw5
S[1]"
LOC=T5;
#Atlyssw6
S[0]"
LOC=E4;
#Atlyssw7
###------------EES261switchinput----------
M"
LOC="
U11"
;
#SW20
C_n"
R10"
#SW19
rst"
U10"
#SW18
CE"
R8"
#SW17
#
Din1[7]"
M8"
#SW16
Din1[6]"
U8"
#SW15
Din1[5]"
U7"
#SW14
Din1[4]"
N7"
#SW13
Din1[3]"
T6"
#SW12
Din1[2]"
R7"
#SW11
Din1[1]"
N6"
#SW10
Din1[0]"
U5"
#SW9
Din[7]"
V5"
#SW8
Din[6]"
P7"
#SW7
Din[5]"
T7"
#SW6
Din[4]"
V6"
#SW5
Din[3]"
P8"
#SW4
Din[2]"
V7"
#SW3
Din[1]"
V8"
#SW2
Din[0]"
N8"
#SW1
#
##----------EES261ledsoutput------------
Qout<
0>
"
U16"
#LED1
1>
U15"
#LED2
2>
U13"
#LED3
3>
M11"
#LED4
4>
R11"
#LED5
5>
T12"
#LED6
6>
N10"
#LED7
7>
M10"
#LED8
###--------------END----------
第四章微程序设计
1.alu_74181
entityalu_74181_2is
Port(A:
inSTD_LOGIC_VECTOR(7downto4);
B:
S:
inSTD_LOGIC_VECTOR(3downto0);
M:
inSTD_LOGIC;
C_n:
F:
outSTD_LOGIC_VECTOR(7downto4);
C_n_plus4:
outSTD_LOGIC);
endalu_74181_2;
architectureBehavioralofalu_74181_2is
signaldata_o_logic:
STD_LOGIC_VECTOR(3downto0);
signaldata_o_arith:
STD_LOGIC_VECTOR(4downto0);
signaldata_sub_tmp:
signalC_n_arith:
begin
F<
=data_o_logicwhenM='
1'
else
data_o_arith(3downto0);
--carryout
C_n_plus4<
=notdata_o_arith(4)whenM='
0'
else'
C_n_arith<
="
0000"
&
(notC_n);
--74181logicoperation
process(A,B,S,M)
begin
case(S)is
when"
=>
data_o_logic<
=notA;
0001"
=not(AorB);
0010"
=(notA)andB;
0011"
=(others=>
'
);
0100"
=not(AandB);
0101"
=notB;
0110"
=(AxorB);
0111"
=Aand(notB);
1000"
=(notA)orB;
1001"
=(AxnorB);
1010"
=B;
1011"
=AandB;
1100"
1101"
=Aor(notB);
1110"
=AorB;
1111"
=A;
whenothers=>
endcase;
endprocess;
endBehavioral;
2.romc
entityromcis
Port(s0:
s1:
s2:
s3:
oen1:
outSTD_LOGIC;
oen2:
w1:
w2:
w3:
gwe1:
gwe2:
gwe3:
oen_n1:
oen_n2:
oen_n3:
outSTD_LOGIC
);
endromc;
architectureBehavioralofromcis
signaladdr:
std_logic_vector(3downto0);
--input
signalrdata:
std_logic_vector(10downto0);
--output
addr<
=s3&
s2&
s1&
s0;
process(addr)
case(addr)is
rdata<
10101000011"
10101100110"
10101000110"
10111001001"
10101001001"
11000010011"
10000010011"
00000000000"
oen1<
=rdata(0);
oen2<
=rdata
(1);
we1<
=rdata
(2);
we2<
=rdata(3);
gwe1<
gwe2<
gwe3<
oen_1<
oen_2<
oen_3<
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- 关 键 词:
- 计算机 组成 原理 作业