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3.TTL单定时器型号的最后几位数字为()。
A.555
B.556
C.7555
D.7556
4.以下电路中,()可以产生脉冲定时。
A.多谐振荡器
B.单稳态触发器
C.施密特触发器
D.石英晶体多谐振荡器
5.对于T触发器,若原态Qn=1,欲使新态Qn+1=1,应使输入T=()。
A.0或/Q
B.1
C.Q
D./Q
6.A+BC=()。
A.A+B
B.A+C
C.(A+B)(A+C)
D.B+C
7.以下代码中为恒权码的为()。
A.循环码
B.5421BCD码
C.余三码
D.格雷码
8.要使TTL与非门工作在转折区,可使输入端对地外接电阻RI()。
A.>
RON
B.<
ROFF
C.ROFF<
RI<
D.>
9.在何种输入情况下,“与非”运算的结果是逻辑0()。
A.全部输入是0
B.任一输入是0
C.仅一输入是0
D.全部输入是1
10.8位移位寄存器,串行输入时经()个脉冲后,8位数码全部移入寄存器中。
A.1
B.2
C.4
D.8
4分
吉大11春学期《数字电子技术》在线作业一
试卷总分:
100测试时间:
--
单选题多选题判断题
二、多选题(共5道试题,共20分。
)V1.CMOS数字集成电路与TTL数字集成电路相比突出的优点是()。
A.微功耗
B.高速度
C.高抗干扰能力
D.电源范围宽
2.下列哪一个是按照电路结构对触发器进行分类的()。
A.基本RS触发器
B.T触发器
C.同步触发器
D.主从触发器
3.下列触发器中,克服了空翻现象的有()。
A.边沿D触发器
B.主从RS触发器
C.同步RS触发器
D.主从JK触发器
4.TTL电路在正逻辑系统中,以下各种输入中()相当于输入逻辑“1”。
A.悬空
B.通过电阻2.7kΩ接电源
C.通过电阻2.7kΩ接地
D.通过电阻510Ω接地
5.逻辑变量的取值1和0可以表示()。
A.开关的闭合、断开
B.电位的高、低
C.真与假
D.电流的有、无
三、判断题(共10道试题,共40分。
)V1.八进制数(18)8比十进制数(18)10小。
A.错误
B.正确
2.4008为四位二进制超前进位全加器。
3.74LS139为4路数据分配器。
4.卡诺图化简法可以更加直观、简捷的逻辑函数化简方法。
5.逻辑函数的简化对于提高电路的可靠性并没有什么作用,因此实际意义不大。
A.错误本文来源于
6.电路结构和其触发方式与功能并没有必然的联系。
7.采用移位寄存器可以把并行数据转化成串行数据。
8.8421码1001比0001大。
9.74LS153为双4选1数据选择器。
10.7的8421BCD码是0101。
吉大11春学期《数字电子技术》在线作业二
)V1.组合逻辑电路消除竞争冒险的方法有()。
A.修改逻辑设计
B.在输出端接入缓冲电路
C.后级加缓冲电路
D.屏蔽输入信号的尖峰干扰
2.为实现将JK触发器转换为D触发器,应使()。
A.J=D,K=/D
B.K=D,J=/D
C.J=K=D
D.J=K=/D
3.当逻辑函数有n个变量时,共有()个变量取值组合。
A.n
B.2n
C.n的平方
D.2的n次方
4.以下电路中,加以适当辅助门电路,()适于实现单输出组合逻辑电路。
A.奇偶校验器
B.数据选择器
C.数值比较器
D.七段显示译码器
5.下列逻辑电路中为时序逻辑电路的是()。
A.变量译码器
B.加法器
C.数码寄存器
D.数据选择器
6.对于TTL与非门闲置输入端的处理,不可以()。
A.接电源
B.通过电阻33kΩ接电源
C.接地
D.与有用输入端并联
7.在下列触发器中,有约束条件的是()。
A.主从JKF/F
B.主从DF/F
C.同步RSF/F
D.边沿DF/F
8.常用的BCD码有()。
A.奇偶校验码
B.格雷码
C.8421码
D.汉明码
9.下列触发器中,没有约束条件的是()。
D.边沿D触发器
10.N个触发器可以构成最大计数长度(进制数)为()的计数器。
B.2N
C.N的平方
D.2的N次方
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