福师《数字逻辑》在线作业一0005Word格式.docx
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1
Vcc
Vee
A
在一个8位的存储单元中,能够存储的最大无符号整数是().
(256)10
(127)10
(FE)16
(255)10
D
下列逻辑门中,()不属于通用逻辑门
与非门
或非门
或门
与或非门
C
一个T触发器,在T=1时,来一个时钟脉冲后,则触发器()。
保持原态
置0
置1
翻转
一个8选一数据选择器的数据输入端有()个
2
3
8
常用的BCD码有().
奇偶校验码
格雷码
8421码
汉明码
若在编码器中有50个编码对象,则要求输出二进制代码位数为()位
5
6
10
50
一个无符号10位数字输入的DAC,其输出电平的级数为()
4
1024
1023
三态门输出高阻状态时,()不正确的说法
用电压表测量指针不动
相当于悬空
电压不高不低
测量电阻指针不动
用ROM实现四位二进制码到四位循环码的转换,要求存储器的容量为()。
16
32
64
8位移位寄存器,串行输入时经()个脉冲后,8位数码全部移入寄存器中
MOS集成电路采用的是()控制,其功率损耗比较小
电压
电流
灌电流
拉电流
采用PLA进行逻辑设计时,应将逻辑函数表达式变换成()
异或表达式
与非表达式
最简“与—或”表达式
标准“或—与”表达式
一个无符号8位数字量输入的DAC,其分辨率为()位
以下代码中为恒权码的为().
循环码
5421BCD码
余三码
卡诺图上变量的取值顺序是采用()的形式,以便能够用几何上的相邻关系表示逻辑上的相邻。
二进制码
ASCII码
十进制码
555的余3码为()
101101101
:
010*********
100010001000
把一个五进制计数器与一个四进制计数器串联可得到()进制计数器
9
20
TTL集成电路采用的是()控制,其功率损耗比较大
格雷码具有任何相邻码只有一位码元不同的特性。
()
错误
正确
复合逻辑运算不是逻辑运算。
在任意时刻,触发器只能处于一种状态。
相同逻辑功能的TTL电路和CMOS电路相比,前者的功耗大
逻辑变量的取值,1比0大。
化简完全确定状态表时,最大等效类的数目即最简状态表中的状态数目。
液晶显示器的优点是功耗极小、工作电压低。
十进制数(9)10比十六进制数(9)16小。
5个触发器最多可以构成16进制计数器
利用反馈归零法获得N进制计数器时,若为异步置零方式,则状态SN只是短暂的过渡状态,不能稳定而是立刻变为0状态。
在以原码形式表示中没有符号位
TTLOC门(集电极开路门)的输出端可以直接相连,实现线与。
三态门的三种状态分别为:
高电平、低电平、不高不低的电压。
在补码表示法中,正数的表示同原码和反码的表示是一样的
触发器和逻辑门一样,输出取决于输入现态
定点表示是指数中的小数点位置固定不变
因为逻辑表达式A+B+AB=A+B成立,所以AB=0成立。
二进制译码器相当于是一个最小项发生器,便于实现组合逻辑电路。
在时间和幅度上都断续变化的信号是数字信号,语音信号不是数字信号。
寄存器分为数码寄存器和移位寄存器
若两个函数具有相同的真值表,则两个逻辑函数必然相等。
若两个函数具有不同的逻辑函数式,则两个逻辑函数必然不相等。
卡诺图化简法可以更加直观、简捷的逻辑函数化简方法。
电平异步时序电路除了可能存在竞争外,还可能存在本质险象
4008为四位二进制超前进位全加器。
设两输入或非门的输入为x和y,输出为z,当z为低电平时,有()。
x和y同为高电平
x为高电平,y为低电平
x为低电平,y为高电平
x和y同为低电平.
A,B,C
不是8421BCD码的是()
1010
0101
1100
1111
A,C,D
PROM、PLA、和PAL三种可编程器件中,()是能编程的
PROM的或门阵列
PAL的与门阵列
PLA的与门阵列和或门阵列
PROM的与门阵列
数字逻辑电路一般分为()。
组合逻辑电路
时序逻辑电路
同步逻辑电路
异步逻辑电路
A,B
PLD的主要类型有()
只读存储器
可编程逻辑阵列PLA
可编程阵列逻辑PAL
通用阵列逻辑GAL
A,B,C,D
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