A+版重点市一级科技计划项目可行性研究报告.docx
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A+版重点市一级科技计划项目可行性研究报告
【A+版】重点市一级科技计划项目可行性研究报告
一、总论
1、项目的主要内容及技术原理简述
A、主要内容
H.264数字视频高清实时解码IC(以下均简称“H.264解码IC”)关键技术研究项目是根据最新的数字视频编码标准H.264/AVC,开发主要应用于IP电视(IPTV)、卫星电视和高清DVD等领域的数字视频高清实时解码高速大规模集成电路(VLSI)专用芯片(ASIC)/片上系统(SoC)的IP核的项目。
在项目中主要对H.264解码IC的系统设计、总线设计、流水线设计等关键技术进行深入研究,并以H.264数字视频高清实时解码IC的IP核作为最终成果进行提交。
B、技术原理
H.264解码IC项目中主要采用了两大技术——H.264编码技术和实时高清VLSI/ASIC/SoC系统的设计技术,H.264编码技术是保证H.264解码IC能够实时、高效解码的理论基础,而实时高清VLSI/ASIC/SoC系统的设计技术则是实现实时、高效的H.264解码IC的关键所在。
下面将分别介绍其技术原理:
①H.264编码技术
H.264编码技术融合了近几年来世界范围内各种视频压缩研究成果之精华,其算法性能远远高于以前的所有H.26R系列和MPEG系列编码算法。
与其他的编码算法相比,H.264编码标准在原理上具有以下新特性:
⑴采用CAVLC和CABAC两种有效的熵编码方式,降低了编码码率;
⑵摒弃了传统的DCT变换方式,对残差数据采用整数变换,减少了编码误差,提高了编码质量;
增加了帧内预测编码模式,提高了对I宏块的编码效率;
⑶在帧内预测编码模式中,可以对多达7种块大小进行高达1/4像素精度的预测编码,且可参考帧数目多达16帧,提高了对P、B宏块的编码效率;
⑷环内去块效应滤波器减小了预测数据与原始图像的残差,提高了残差的编码效率。
②实时高清VLSI/ASIC/SoC系统的设计技术
从规模上说,H.264解码IC的实现估计需要耗用几十万甚至上百万的晶体管,因此可以说是一个VLSI系统;从应用领域看,H.264解码IC是专用于IPTV、卫星电视和高清DVD等高清数字视频领域的ASIC系统;从设计平台来讲,H.264解码IC是基于SoC设计的系统。
因此,在进行H.264解码IC设计时,将采用VLSI、ASIC和SoC等设计中的关键技术,主要包括并行处理技术、流水处理技术、总线及存储技术、测试技术、EDA技术等。
2、项目的目的和意义
H.264解码IC具有广泛的应用价值和潜在的巨大市场价值,同时,对缩短国内外的消费IC设计技术差距也有重大意义。
A、广泛的应用价值
基于H.264的先进性,H.264技术已经由ITU国际电信联盟、MPEG移动图像专家组、DVD联盟、DVB数字视频广播组织和3GPP第三代移动通信合作组织等国际标准组织确定为首选或必须采用的信源编码标准,被业界认为是最具发展潜力的下一代视频编码技术。
B、缩短与国际先进消费IC设计企业之间的距离
目前国外已有多家公司发布了H.264高清解码IC的样片,而国内暂无公司发表样片。
因此,在消费IC上加大投入和扶持力度,对于进一步缩短国内外的技术差距有着重大意义。
3、相关技术领域国内外发展现状、趋势
A、国外发展现状
国外各大厂商在H.264解码芯片上的竞争从H.264标准正式公布之前就已经开始了。
标准正式公布约半年后,博通(Broadcom)、科胜迅(ConeRant)、意法半导体(ST)以及SigmaDesigns等半导体厂商几乎同时宣布了将在2005年初批量发送H.264解码芯片,主要针对的应用领域为IPTV、卫星电视和高清DVD等市场。
B、国内发展现状
国内的竞争虽然不如国外激烈,然而也有不少厂商公布了其产品。
ZR联合(BJ)微电子有限公司在20RR年R月发布了可同时支持包括业界最新标准H.264在内的多模高清视频解码IP核ODM3P-S。
就在中芯发布其ODM3P-S的同时,上海富瀚微电子有限公司也发布了支持标清(SD)的H.264/MPEG-4AVC解码ASICIP核——FH8600。
C、H.264解码器芯片的发展趋势
将国内外几种主流H.264解码芯片主要参数归纳一下,如表1所示。
表1、国内外几种主流H.264解码芯片的比较
IC
公司
Profile&Level
图像大小
技术
BCM7411
BroadCom
HP@L4.1
1080i
0.13μm
CR2418R
ConeRant
HP@L4
1920×1080
0.13μm
STB7100
ST
HP@L4
HD
0.09μm
SMP8630
Sigma
Designs
BP@L3,
MP@L4.1
HP@L4.1,
1280×720
-
ODM3P-S
ZR
HP@L4.1
1080i
0.18μm
FH8600
RY
MP@L3
720×480
0.18μm
从表1中不难发现,H.264解码器芯片的发展有两大趋势:
●更高的性能:
目前各厂商的解码器所支持的功能集正由MainProfile向HighProfile提升,而且所支持的图幅也正由SD向HD发展;
●更高的工艺:
国内的制造厂商一般采用0.18μm的制造工艺,而国外的厂商则一般采用0.13μm的工艺,更有甚者,采用0.09μm的工艺。
这是工艺发展的必然结果,也是为了满足日益强大的解码器性能的必然要求。
4、项目申请单位、主要合作申请单位及项目主要负责人的基本情况
A、项目申请单位
项目申请单位JR省科学院计算机信息中心成立于九十年代初期,并由省级机构编制主管部门——JR省机构编制委员会办公室(赣编办文[20RR]81号)批准更名为现名,并经核准登记的全民所有制的事业法人单位。
该单位是由原JR省科学院软件工程技术中心和JR省科学院机电仪一体化研究中心两个单位重组而成的。
主要合作申请单位华中科技大学电信系数字视频技术与通信中心成立于九十年代初,原名为华中科技大学电信系数字视频技术与通信实验室,于2001年与系内多个实验室合并成立中心。
B、主要负责人的基本情况
项目总负责人TLD研究员,JR省科学院计算机信息中心副主任。
19RR年毕业于太原重型机械学院机械设计系,20RR年NC大学电气与自动化工程学院控制科学与工程专业硕士研究生毕业。
目前研究方向为:
网络信息管理系统研究、公共网络服务平台研究、软件工程设计。
曾主持JR省工业科技攻关重大、重点项目“全国计算机信息高新技术考试多媒体电脑教学辅助软件平台研究及其系列光盘开发”、“公共卫生检验流程SCInet系统软件开发及制作”等项目等几项科研项目,发表论文十余篇。
项目技术负责人WHY教授、博士生导师。
19RR年毕业于BJ理工大学(原BJ工学院)无线电工程系,19RR年调入HZ理工大学电子与信息工程系。
19RR年~198YY年作为留美访问学者在OKLAHOMA大学从事通信和数字信号处理的研究工作。
目前研究方向为:
图像通信和现代数字信号处理。
曾主持窄带可视电话、无线数字调制解调、数字卫星电视接收机、数字高清晰度电视接收机、数字电视台前端设备、QAM调制器、MPEG-2编码器等十余项科研项目。
在国际IEEE杂志、国内《电子学报》、《自动化学报》和其他杂志发表论文60余篇。
5、有关本项目的现有工作基础和支撑条件
JR省科学院计算机信息中心先后承担了国家、省部级重点科研项目共8项。
“JAM-I型脑电地形图仪”项目获得了19RR年度省科技进步二等奖;“JAM综合脑电图系统”项目得到了19RR年度省计委重大项目经费支持。
上述项目的成功实施,使本单位掌握了以PowerPCG4、SHARC、FPGA、AD21K为核心的多片DSP板等在生物电信息处理系统中的具体设计应用,尤其是用于劣环境的嵌入式计算,高速采集、数字信号处理板极产品中积累了丰富的经验,这为本单位在H.264解码原型系统的设计与实验、测试软件设计、片上系统的软件设计和仿真试验等方面开展研究工作提供了雄厚的技术应用基础。
HZ科技大学电信系数字视频技术与通信中心曾承担过深圳创维、武汉国测高科等公司的数字电视台前端设备、数字电视接收系统、电力网络视频监控等大中型项目,曾独立开发出MPEG、MPEG-2、H.261、H.263等编解码器,具有很好的工作基础。
目前正在进行MPEG-4VSP编解码器的开发和H.264解码器的研究工作,可以对H.264解码IC项目形成有力支撑。
JR省科学院计算机信息中心和华中科技大学电信系数字视频技术与通信中心,在20RR年就已经合作开展了相关子课题的前期研究工作,如双方共同提出的H.264解码原型系统的设计与实验方案已完成,此外双方还提出完全符合H.264标准high4:
4:
4profile技术规范,支持到level4.0的高清实时视频解码器的可实现设计方案并对方案进行了快速原型验证等基础性工作,为加快本项目的研制创造了良好的基础。
二、项目实施方案
1、项目达到的目标及考核的主要技术经济指标(含知识产权、技术标准)
本项目的攻关目标为开发具有自主知识产权的高性价比、高可靠性的实时H.264解码IC的IP核。
该芯片IP核预计达到H.264编码标准的以下技术指标:
A.完全遵循H.264/MPEG-4AVC标准;
B.支持High4:
4:
4profile最高至Level4.0;
C.实时解码;
D.支持多种格式和帧率:
SQCIF(最大172帧/秒)、QCIF(最大172帧/秒)、CIF(最大102帧/秒)、4CIF(最大25帧/秒)等;
E.具备流错误检测和恢复功能。
2、项目的主要研究(开发)内容
本项目主研究完全符合H.264标准high4:
4:
4profile,支持到level4.0的高清实时视频解码器的可实现设计、在SoC平台上大规模可编程逻辑实现、在FPGA平台上的实时验证等方面的相关内容。
3、试验(开发)规模及地点
JR省科学院计算机信息中心负责H.264解码原型系统的设计与实验、测试软件设计、片上系统的软件设计和仿真试验等。
其试验人员由研究员、副研究员、硕士研究生以梯形纵队形式组成,参加人员约12人左右,实验开发地点位于JR省科学院计算机信息中心内(NC)。
华中科技大学数字视频与通信中心负责高速大规模逻辑电路系统设计、系统总线结构研究、系统中的流水线结构研究、外置随机存储器的存储组织和对外置随机存储器的快速访问技术研究、严格遵守H.264标准采用硬件描述语言进行系统设计和调试。
试验人员由博导、博士研究生、硕士研究生以梯形纵队形式组成,预计人数达到10人左右。
开发地点为华中科技大学电信系数字视频技术与通信中心。
最后的综合性试验,如在FPGA平台上验证本设计方案等,则由双方的研发人员在JR省科学院计算机信息中心内(NC)进行,参加试验的人数达约10人左右。
4、主要技术关键及创新点
A、主要技术关键
H.264实时高清解码器在设计上有两大难点,一是要满足高处理速度的要求;二是要满足高数据吞吐量的要求。
因此,项目中的主要技术关键就在于如何提高处理速度和如何降低或分散数据吞吐量。
B、创新点
作为一个可实现的设计方案,在设计上,本项目的H.264解码IC的IP核有以下创新点:
①采用多级流水线处理结构以提高系统的处理能力;
②采用双总线的系统设计以分散数据吞吐量;
③采用独特的外置随机存储器的存储组织和对外置随机存储器的快速访问技术来满足系统对数据吞吐量的高要求。
C、查新结论
根据JR省专利事务所20RR年R月R日的提供的科技查新报告的查新结论:
“按照给定的检索策略中的检索词及检索式,以及多种检索词组合,特别是将“H.264”与“双总线”和“流水线”这两个关键词组合进行枚举、检索,均未检索到与本课题内容相同的文献报道。
”
值得一提是“科技查新报告”检索出一个相关文献,该文献提到的CAVLC解码器实质上是一个熵解码器,仅仅是本项目中要做的H.264的解码器中的一个模块(可以在本项目的系统框图中看到)。
此外,检索结果中的CAVLC解码器只有level3.0的性能要求,而本项目预期的H.264解码器的性能目标是High4:
4:
4Profilelevel4.0,也就是说检索结果中的解码器设计并没有本项目中的技术指标先进。
如果将该性能指标加入到关键词中,则相类似的文献将一篇都难以查到。
5、实施方案(含技术路线、工艺流程及技术关键的解决方案)
A、技术路线
如图1所示,本系统采用流水处理的方式提高解码器性能,采用双总线结构突破总线带宽瓶颈。
考虑到软件实现比硬件实现灵活性好,成本低,设计周期短,且易验证,所以在满足性能和实时要求的前提下,用软件来实现SH(SliceHeader)及其以上部分的解析任务、解码图像缓冲区DPB(DecodedPictureBuffer)的管理和解码器状态控制。
而对于运算量大、速度要求高的模块,如图1中灰色框中各模块,则采用硬件实现。
下面对系统中的模块作简要介绍:
图1、H.264解码器系统结构图
①RISC核
RISC核主要负责SH及其以上部分的解析任务、解码图像缓冲区DPB的管理和解码器状态控制。
②H.264码流分解
码流分解部分负责接收H.264标准码流,并从NAL(NetworkAbstractionLayer)中解出RBSP(RawByteSequencePayload),然后将不同类型的RBSP分别传送给相应的处理单元。
其中,含有SPS(SequenceParameterSet)、PPS(PictureParameterSet)、SH的RBSP传给RISC核,含有SD(SliceData)的RBSP则传给硬件解码部分进行处理。
③硬件解码部分
硬件解码部分主要有五个模块构成,分别是熵解码模块、反变换模块ISIQIDCT、帧内预测模块、帧间预测模块、去块效应滤波模块。
熵解码模块仅负责对SD类型的RBSP进行熵解码。
反变换模块则对残差数据进行反变换和反量化操作。
帧内预测模块根据参数进行帧内预测,为了提高流水线的处理速度,可进一步细分为帧内预测模式计算模块IntraMode和帧内预测计算模块IntraPred。
而帧间预测模块负责进行帧间预测,出于同样的原因,也被进一步细分,分为运动矢量计算模块MVP、参考数据读取模块ReadRef和帧间预测计算模块InterPred。
B、工艺流程
整个项目分3个阶段完成,即整个项目的工艺流程如下:
①提出完全符合H.264标准high4:
4:
4profile,支持到level4.0的高清实时视频解码器的可实现设计方案并对方案进行快速原型验证;
②在SoC平台上采用硬件描述语言实现满足上述要求的H.264解码IC并采用仿真工具对其进行仿真验证;
③在FPGA平台上实现满足上述要求的H.264解码IC并对其进行实时验证,并形成IP核。
C、技术关键的解决方案
①双总线设计
为了缓解系统总线带宽的压力,我们在设计中采用了双总线结构——总线A和总线B,如图1所示。
总线A为32-bit的AHB总线,线上挂有H.264码流分解模块(主设备)、RISC核(主设备)、硬件解码部分(从设备)以及硬件解码寄存器组(从设备),总线A主要用于各模块间的控制信号和少量数据的传输。
总线B为自定义的64-bit的局部总线,主要用于DPB数据的高速读写。
②流水线设计
本解码器采用5级流水线的处理方式来提高系统解码速度。
由于采用了流水线技术,只要图2中所标示的各模块处理单个宏块所需的时钟周期数小于
(其中f为芯片采用的系统时钟的时钟频率),即可满足实时解码的要求。
图2、硬件解码部分解码流程示意图
③DPB数据存储组织和读写
在解码器设计时,我们力图DPB数据存储组织结构能够以不变应万变,以相对固定的方式存储H.264建议中各种像素精度和色度精度的图像,从而简化DPB管理逻辑的设计,提高对片外DPB随机存储器的读写速度。
6、技术风险分析
如今的半导体工艺已经允许我们设计出包含几亿个晶体管的芯片,VLSI设计的难度已经大大降低,因此越来越多的芯片设计商、芯片制造商针对各种不同的应用制造出相应的专用芯片(ASIC)。
现代工艺所提供的巨大的集成能力,使得片上系统(SoC)的设计,也从过去的世界尖端技术发展成为当今的一种主流技术。
然而,这并不意味着在进行H.264解码芯片的开发过程中不存在任何风险。
由于264解码过程的复杂性,可能导致最后提交的IP核本身存在严重的功能或性能缺陷,但对于管理规范且有经验的设计团队而言,这类风险是完全可以避免的。
因此,在本项目中几乎可以不考虑设计风险。
综上,本项目中虽然存在技术风险,但是只要对项目进行自始至终的科学组织、管理,项目的技术风险是不足以挡住立项的脚步的。
7、分年度的工作内容、目标
20RR年R月~Y月:
方案设计。
目标:
提出完全符合H.264标准high4:
4:
4profile,支持到level4.0的高清实时视频解码器的可实现设计方案并对方案进行快速原型验证;
20RR年R月~Y月:
设计和仿真验证。
目标:
在SoC平台上采用硬件描述语言实现满足上述要求的H.264解码IC并采用仿真工具对其进行仿真验证;
20RR年RR月~YY月:
实时验证。
目标:
在FPGA平台上实现满足上述要求的H.264解码IC的IP核并对其进行实时验证。
8、申请单位、合作申请单位及主要人员的分工
A、申请单位及分工
项目的申请单位是JR省科学院计算机信息中心。
按研发协议,JR省科学院计算机信息中心将负责H.264解码原型系统的设计与实验、测试软件设计、片上系统的软件设计和仿真试验等。
B、合作申请单位及分工
项目的合作单位华中科技大学数字视频技术与通信中心。
按研发协议,华中科技大学数字视频与通信中心负责高速大规模逻辑电路系统设计、系统总线结构研究、系统中的流水线结构研究、外置随机存储器的存储组织和对外置随机存储器的快速访问技术研究、严格遵守H.264标准采用硬件描述语言进行系统设计和调试。
9、组织及管理的运行机制
本项目的课题负责人为JR省科学院计算机信息中心的谭立地研究员,作为本项目的总负责人;华中科技大学电子与信息工程系王宏远教授为本项目的技术负责人。
项目采用金字塔形的研发队伍组织形式。
组织以项目总负责人为核心的专家小组,完成系统设计方案,对总体方案负责并定期检查各组的工作完成情况,及时解决项目实施中的实际问题,确保项目进度和完成质量。
专家小组下成立若干个技术设计小组,每组2~3人,实施设计小组组长负责制,负责本小组内的专项研究及子课题组之间的协调,定期向专家小组汇报工作成果并在遇到组内讨论不能解决的困难时向专家小组请求援助。
项目的两个合作单位为在研究过程中能够保障本项目的实施成功,我们已通过前期产品的研发工作,建立了一套完整的管理控制体系:
密切关注数字视频领域技术发展动向,有助于我们在项目研究过程中始终站在技术的前沿;加强项目研究的组织与领导管理,抓住项目接口特性这个基础,进行项目的划分;加强项目的计划与进度管理,项目计划,目标制定的严密程度,直接关系到项目研究的成功与否;加强项目的保密措施管理,强化保密措施;加强参研人员的流动性管理;加强产品研制文档管理。
文档资料是研究项目的成果表现形式,也是风险最大的地方,有效的管理是规避风险的有效措施。
10、相关依托工程(含技术)的落实情况
前述已阐明,本项目业已完成H.264解码原型系统的设计与实验方案,并提出了完全符合H.264标准high4:
4:
4profile的技术规范,支持到level4.0的高清实时视频解码器的可实现设计方案并对方案进行了快速原型验证等基础性工作也告一段落。
因此,本项目立项后所要进行的主要工作是在SoC平台上采用硬件描述语言实现满足上述要求的H.264解码IC并采用仿真工具对其进行仿真验证,以及在FPGA平台上实现满足上述要求的H.264解码IC并对其进行实时验证,并形成IP核。
对于这两项工作可JR省科学院计算机信息中心和华中科技大学电信系数字视频技术与通信中心内即可进行,只是需要一定的经费支持。
此外,JR省科学院计算机信息中心将推动拥有我省自主知识产权的高技术产品产业化、共同的共同理念,经友好协商,对该项目产业化过程中前期工作——重点推广项目申报、产业化资金资助申请等进行合作。
JR省科学院计算机信息中心致力于JR境内的数字视音频的研究开发工作,包括后续进行的视音频压缩技术、加密处理技术、编解码技术和降噪技术的研发,力争双方共同合作建设JR省的数字化视听技术及产品成果转化的一个基地。
JR省科学院计算机信息中心与华中科技大学电信系数字视频技术与通信中心双方约定后者投入的20万项目产业化的启动资金主要用于:
产业化项目的省级重点推广项目申报、省部级产业化资金资助申报、项目的规划与设计等其它必要的产业化前期工作的活动经费。
JR省科学院计算机信息中心与华中科技大学电信系数字视频技术与通信中心双方共同申报相关部门的产业化资金成功之后,该资金归于由双方共同出资组建一个专业的IC芯片股份公司所有。
JR省科学院也将上述合作事项列入JR省科学院“十一五”期间进行重点产业化的一件大事来抓,并支持将该技术尽快产业化,使其达到1000万美元产值。
11、有关本项目的国内外知识产权状况分析
前面已经提到,“科技查新报告”只检索出一个相关文献,该文献提到的CAVLC解码器实质上是一个熵解码器,仅仅是本项目中要做的H.264的解码器中的一个模块(可以在本项目的系统框图中看到)。
此外,检索结果中的CAVLC解码器只有level3.0的性能要求,而本项目预期的H.264解码器的性能目标是High4:
4:
4Profilelevel4.0,也就是说检索结果中的解码器设计并没有本项目中的技术指标先进。
因此,项目中除了H.264标准外,其他技术都具有自由知识产权。
本项目在后续的产业化阶段时,除了用到H.264标准可能需要向ITU-T组织缴纳相关费用外,无需向其他任何组织缴纳知识产权费用。
据有关资料报道,H.264的许可费用有望在基线层面全员免费,无偿使用,其许可体系要比MPEG-4单纯,公正无差别对待用户和知识产权持有者。
以及其它能促进普及的优惠政策,如早期低价格许可等。
三、市场分析
1、市场预测(含同类项目的国内外市场情况)
以项目在国内的市场预测为例,目前中国正实现从模拟电视向数字电视过渡时期,H.264芯片仅在数字电视领域就存在着过亿的潜在市场。
以2美元/片的利润、10%的市场占有率来计算,本项目在数字电视领域创造的利润就有2千万美元。
目前国外的H.264解码IC样片已投放市场,估价为20~30美元/片,而国内目前还没有H.264的样片投放市场。
如果本项目的H.264解码IC能按预期投放市场,不但能够缩小国内与国外在消费IC开发和生产技术上的距离,还能够为国家节省数十亿甚至上百亿的外汇,其经济社会效益不言而喻。
目前国内外市场上还没有一个公司批量生产H.264解码芯片。
然而,由于H.264标准已被ITU国际电信联盟、MPEG移动图像专家组、DVD联盟、DVB数字视频广播组织和3GPP第三代移动通信合作组织等国际标准组织确定为首选或必须采用的信源编码标准,因此,通用的H.264解码芯片有着巨大的潜在市场。
2、本项目的市场竞争优势、风险及市场策略
A、市场竞争优势
①低成本。
众所周知,低成本是科研院所、大专院校技术开发的最大优势,在此不再赘述。
因此,本项目开发的芯片IP核也继承了这一优势。
而这一优势,在竞争日益白热化的家电行业则显得格外突出。
②通用型芯片
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